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dtpr_versuch_7_hide [2014/11/06 08:14] lueder [Zähler für den Sync Zähler (synccnt)] |
dtpr_versuch_7_hide [2014/11/06 08:27] lueder [Zähler für den Sync Zähler (synccnt)] |
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| === Designphase === | === Designphase === | ||
| - | Setzen Sie jetzt das Design in VHDL um. Dazu gibt es die Vorlage "synccnt_rtl.vhd" Simulieren Sie das Design im Simulator im Verzeichnis sim/synccnt. Es kann hilfreich sein die Dateien, die in sim/makefile.sources auf Vollständigkeit zu überprüfen. | + | Setzen Sie jetzt das Design in VHDL um. Dazu gibt es die Vorlage "synccnt_rtl.vhd" Simulieren Sie das Design im Simulator im Verzeichnis sim/synccnt. Es kann hilfreich sein die Pfade der Komponenten, die in sim/makefile.sources sind auf Vollständigkeit zu überprüfen. |
| === Verifikationsphase === | === Verifikationsphase === | ||