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dtpr_versuch_8 [2013/12/18 14:04]
beckmanf [Zustandsautomat syncsm] - mux weg
dtpr_versuch_8 [2014/01/03 15:42] (current)
beckmanf [Zustandsautomat syncsm] - VHDL Automatencode eingefügt
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   * Verifizieren Sie das Design auf dem FPGA und messen Sie das hsync und vsync Timing   * Verifizieren Sie das Design auf dem FPGA und messen Sie das hsync und vsync Timing
  
 +=== Umsetzung mit VHDL Automatencode ===
 +
 +  * Setzen Sie jetzt den Automaten mit VHDL um und verwenden Sie dazu die Beschreibung wie in play_rtl.vhd
 +  * Verifizieren Sie den Automaten im Simulator ​
 +  * Finden Sie mit Quartus die Anzahl der benötigten Flipflops für den Automaten heraus. ​
  
  
  
  
  • dtpr_versuch_8.txt
  • Last modified: 2014/01/03 15:42
  • by beckmanf